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填空題
Verilog HDL的功能描述可以用（）、（）、（）和（）等方法來實(shí)現(xiàn)，通常把確定這些設(shè)計(jì)模塊描述的方法稱為建模。
答案：
assign語句；元件例化（instantiate）；always塊語句；initial塊語句
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填空題
Verilog HDL的模塊Verilog HDL模塊的T/O聲明用來聲明模塊端口定義中各端口數(shù)據(jù)流動(dòng)方向，包括（）、（）和（）。
答案：
輸入（input）；輸出（output）；雙向（inout）
