填空題

組合邏輯電路在任意時(shí)刻的穩(wěn)定輸出信號(hào)取決于（）

答案： 此時(shí)的輸入
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對(duì)于兩輸入的或非門而言，只有當(dāng)為（）時(shí)輸出為1。
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（）和卡諾圖化簡(jiǎn)法都可用來(lái)化簡(jiǎn)多輸出函數(shù)。
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