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【計(jì)算題】試設(shè)計(jì)一個(gè)CMOS門電路,實(shí)現(xiàn)邏輯關(guān)系L=AB+C,畫出邏輯電路圖。
答案:
實(shí)現(xiàn)邏輯關(guān)系L=AB+C的CMOS邏輯電路如圖所示。
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列出圖所示電路的真值表。
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